Mário Pereira Véstias
AuthID: R-000-CZ3
1
TÃTULO: Design of Real-Time Gesture Recognition with Convolutional Neural Networks on a Low-End FPGA Full Text
AUTORES: Duarte, Rui Policarpo; Goncalves, Tiago; Jacinto, Gustavo; Flores, Paulo; Vestias, Mario;
PUBLICAÇÃO: 2025, FONTE: ELECTRONICS, VOLUME: 14, NÚMERO: 17
AUTORES: Duarte, Rui Policarpo; Goncalves, Tiago; Jacinto, Gustavo; Flores, Paulo; Vestias, Mario;
PUBLICAÇÃO: 2025, FONTE: ELECTRONICS, VOLUME: 14, NÚMERO: 17
2
TÃTULO: PT-Float: A Floating-Point Unit with Dynamically Varying Exponent and Fraction Sizes
AUTORES: de Sousa, Jose T.; Lopes, Joao D.; Serodio, Micaela; Neto, Horacio C.; Vestias, Mario P.;
PUBLICAÇÃO: 2024, FONTE: 31st Symposium on Computer Arithmetic (ARITH) in PROCEEDINGS 2024 IEEE 31ST SYMPOSIUM ON COMPUTER ARITHMETIC, ARITH 2024
AUTORES: de Sousa, Jose T.; Lopes, Joao D.; Serodio, Micaela; Neto, Horacio C.; Vestias, Mario P.;
PUBLICAÇÃO: 2024, FONTE: 31st Symposium on Computer Arithmetic (ARITH) in PROCEEDINGS 2024 IEEE 31ST SYMPOSIUM ON COMPUTER ARITHMETIC, ARITH 2024
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WOS
Scopus WOS3
TÃTULO: High-Performance Embedded System for Onboard Object Detection in Hyperspectral Images
AUTORES: Vestiasa, Mario; Nascimento, Jose;
PUBLICAÇÃO: 2024, FONTE: 2024 Conference on Artificial Intelligence and Image and Signal Processing for Remote Sensing in ARTIFICIAL INTELLIGENCE AND IMAGE AND SIGNAL PROCESSING FOR REMOTE SENSING XXX, VOLUME: 13196
AUTORES: Vestiasa, Mario; Nascimento, Jose;
PUBLICAÇÃO: 2024, FONTE: 2024 Conference on Artificial Intelligence and Image and Signal Processing for Remote Sensing in ARTIFICIAL INTELLIGENCE AND IMAGE AND SIGNAL PROCESSING FOR REMOTE SENSING XXX, VOLUME: 13196
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Scopus WOS4
TÃTULO: Deep learning on Edge: Challenges and trends
AUTORES: Mário Véstias;
PUBLICAÇÃO: 2022, FONTE: Research Anthology on Edge Computing Protocols, Applications, and Integration
AUTORES: Mário Véstias;
PUBLICAÇÃO: 2022, FONTE: Research Anthology on Edge Computing Protocols, Applications, and Integration
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Scopus5
TÃTULO: Decimal multiplication in FPGA with a novel decimal adder/subtractor
AUTORES: Mário Véstias; Horácio C Neto;
PUBLICAÇÃO: 2021, FONTE: Algorithms, VOLUME: 14, NÚMERO: 7
AUTORES: Mário Véstias; Horácio C Neto;
PUBLICAÇÃO: 2021, FONTE: Algorithms, VOLUME: 14, NÚMERO: 7
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Handle6
TÃTULO: Stochastic theater: stochastic datapath generation framework for fault-tolerant IoT sensors
AUTORES: Rui P Duarte; Mário Véstias; Carlos Carvalho; João Casaleiro;
PUBLICAÇÃO: 2018, FONTE: i-ETC: ISEL Academic Journal of Electronics, Telecommunications and Computers, VOLUME: 4, NÚMERO: 1
AUTORES: Rui P Duarte; Mário Véstias; Carlos Carvalho; João Casaleiro;
PUBLICAÇÃO: 2018, FONTE: i-ETC: ISEL Academic Journal of Electronics, Telecommunications and Computers, VOLUME: 4, NÚMERO: 1
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Handle7
TÃTULO: A many-core overlay for high performance embedded computing on FPGAS
AUTORES: Mário Véstias; Horácio Neto;
PUBLICAÇÃO: 2014, FONTE: 1st International Workshop on FPGAs for Software Programmers (FSP 2014)
AUTORES: Mário Véstias; Horácio Neto;
PUBLICAÇÃO: 2014, FONTE: 1st International Workshop on FPGAs for Software Programmers (FSP 2014)
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Handle8
TÃTULO: Adaptive Network-on-Chip
AUTORES: Mário Véstias; Horácio C Neto;
PUBLICAÇÃO: 2014, VOLUME: 8
AUTORES: Mário Véstias; Horácio C Neto;
PUBLICAÇÃO: 2014, VOLUME: 8
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Scopus9
TÃTULO: Hardware Design for Decimal Multiplication
AUTORES: Mário Véstias; Horácio C Neto;
PUBLICAÇÃO: 2014, VOLUME: 8
AUTORES: Mário Véstias; Horácio C Neto;
PUBLICAÇÃO: 2014, VOLUME: 8
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Scopus10
TÃTULO: Decimal division using the newton-raphson method and radix-1000 arithmetic
AUTORES: Vestias, MP; Neto, HC;
PUBLICAÇÃO: 2013, FONTE: Embedded Systems Design with FPGAs
AUTORES: Vestias, MP; Neto, HC;
PUBLICAÇÃO: 2013, FONTE: Embedded Systems Design with FPGAs
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